From: Cherry Zhang Date: Tue, 30 Aug 2016 18:46:25 +0000 (-0400) Subject: cmd/compile, runtime, etc: get rid of constant FP registers X-Git-Tag: go1.8beta1~1554 X-Git-Url: http://www.git.cypherpunks.su/?a=commitdiff_plain;h=f9dafc742d7c0e892b6e4ff17cb9ec7165887e44;p=gostls13.git cmd/compile, runtime, etc: get rid of constant FP registers On ARM64, MIPS64, and PPC64, some floating point registers were reserved for constants 0, 1, 2, 0.5, etc. This CL removes them. On ARM64, they are never used. On MIPS64 and PPC64, the only use case is a multiplication-by-2 in the old backend of the compiler, which is replaced with an addition. Change-Id: I737cbf43283756e3408964fc88c567a938c57036 Reviewed-on: https://go-review.googlesource.com/28095 Run-TryBot: Cherry Zhang Reviewed-by: David Chase TryBot-Result: Gobot Gobot --- diff --git a/src/cmd/compile/internal/arm64/gsubr.go b/src/cmd/compile/internal/arm64/gsubr.go index 2dcde169a0..e225ca6f87 100644 --- a/src/cmd/compile/internal/arm64/gsubr.go +++ b/src/cmd/compile/internal/arm64/gsubr.go @@ -43,10 +43,6 @@ var resvd = []int{ arm64.REGRT1, arm64.REGRT2, arm64.REG_R31, // REGZERO and REGSP - arm64.FREGZERO, - arm64.FREGHALF, - arm64.FREGONE, - arm64.FREGTWO, } /* diff --git a/src/cmd/compile/internal/mips64/gsubr.go b/src/cmd/compile/internal/mips64/gsubr.go index a667747bdd..741f6cdbda 100644 --- a/src/cmd/compile/internal/mips64/gsubr.go +++ b/src/cmd/compile/internal/mips64/gsubr.go @@ -47,10 +47,6 @@ var resvd = []int{ mips.REGTMP, mips.REG_R26, // kernel mips.REG_R27, // kernel - mips.FREGZERO, - mips.FREGHALF, - mips.FREGONE, - mips.FREGTWO, } /* @@ -516,8 +512,7 @@ func gmove(f *gc.Node, t *gc.Node) { if ft == gc.TUINT64 { p1 := ginsbranch(mips.ABEQ, nil, &rtmp, nil, 0) - gc.Nodreg(&r1, gc.Types[gc.TFLOAT64], mips.FREGTWO) - gins(mips.AMULD, &r1, &r2) + gins(mips.AADDD, &r2, &r2) gc.Patch(p1, gc.Pc) } diff --git a/src/cmd/compile/internal/mips64/reg.go b/src/cmd/compile/internal/mips64/reg.go index 0efa159218..d3849332c8 100644 --- a/src/cmd/compile/internal/mips64/reg.go +++ b/src/cmd/compile/internal/mips64/reg.go @@ -112,10 +112,6 @@ func regnames(n *int) []string { func excludedregs() uint64 { // Exclude registers with fixed functions regbits := 1<<0 | RtoB(mips.REGSP) | RtoB(mips.REGG) | RtoB(mips.REGSB) | RtoB(mips.REGTMP) | RtoB(mips.REGLINK) | RtoB(mips.REG_R26) | RtoB(mips.REG_R27) - - // Also exclude floating point registers with fixed constants - regbits |= RtoB(mips.FREGZERO) | RtoB(mips.FREGHALF) | RtoB(mips.FREGONE) | RtoB(mips.FREGTWO) - return regbits } diff --git a/src/cmd/compile/internal/ppc64/gsubr.go b/src/cmd/compile/internal/ppc64/gsubr.go index 8140d397c7..7d8e47c4e3 100644 --- a/src/cmd/compile/internal/ppc64/gsubr.go +++ b/src/cmd/compile/internal/ppc64/gsubr.go @@ -51,11 +51,6 @@ var resvd = []int{ // TODO(austin): Consolidate REGTLS and REGG? ppc64.REGG, ppc64.REGTMP, // REGTMP - ppc64.FREGCVI, - ppc64.FREGZERO, - ppc64.FREGHALF, - ppc64.FREGONE, - ppc64.FREGTWO, } /* @@ -500,8 +495,7 @@ func gmove(f *gc.Node, t *gc.Node) { gc.Regfree(&r1) if ft == gc.TUINT64 { p1 := gc.Gbranch(optoas(gc.OLT, gc.Types[gc.TUINT64]), nil, +1) // use CR0 here again - gc.Nodreg(&r1, gc.Types[gc.TFLOAT64], ppc64.FREGTWO) - gins(ppc64.AFMUL, &r1, &r2) + gins(ppc64.AFADD, &r2, &r2) gc.Patch(p1, gc.Pc) } gmove(&r2, t) diff --git a/src/cmd/compile/internal/ppc64/reg.go b/src/cmd/compile/internal/ppc64/reg.go index d93eb5c080..f7033f6ef8 100644 --- a/src/cmd/compile/internal/ppc64/reg.go +++ b/src/cmd/compile/internal/ppc64/reg.go @@ -119,9 +119,6 @@ func excludedregs() uint64 { regbits |= RtoB(ppc64.REG_R2) regbits |= RtoB(ppc64.REG_R12) } - // Also exclude floating point registers with fixed constants - regbits |= RtoB(ppc64.REG_F27) | RtoB(ppc64.REG_F28) | RtoB(ppc64.REG_F29) | RtoB(ppc64.REG_F30) | RtoB(ppc64.REG_F31) - return regbits } diff --git a/src/cmd/compile/internal/ssa/gen/ARM64Ops.go b/src/cmd/compile/internal/ssa/gen/ARM64Ops.go index 2312b32603..917c4a7424 100644 --- a/src/cmd/compile/internal/ssa/gen/ARM64Ops.go +++ b/src/cmd/compile/internal/ssa/gen/ARM64Ops.go @@ -91,10 +91,10 @@ var regNamesARM64 = []string{ "F25", "F26", "F27", - "F28", // 0.0 - "F29", // 0.5 - "F30", // 1.0 - "F31", // 2.0 + "F28", + "F29", + "F30", + "F31", // pseudo-registers "SB", @@ -128,7 +128,7 @@ func init() { gpsp = gp | buildReg("SP") gpspg = gpg | buildReg("SP") gpspsbg = gpspg | buildReg("SB") - fp = buildReg("F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27") + fp = buildReg("F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31") callerSave = gp | fp | buildReg("g") // runtime.setg (and anything calling it) may clobber g ) // Common regInfo diff --git a/src/cmd/compile/internal/ssa/gen/MIPS64Ops.go b/src/cmd/compile/internal/ssa/gen/MIPS64Ops.go index 0feced5c73..420c652dcd 100644 --- a/src/cmd/compile/internal/ssa/gen/MIPS64Ops.go +++ b/src/cmd/compile/internal/ssa/gen/MIPS64Ops.go @@ -88,13 +88,13 @@ var regNamesMIPS64 = []string{ "F21", "F22", "F23", - "F24", // 0.0 + "F24", "F25", - "F26", // 0.5 + "F26", "F27", - "F28", // 1.0 + "F28", "F29", - "F30", // 2.0 + "F30", "F31", "HI", // high bits of multiplication @@ -132,7 +132,7 @@ func init() { gpsp = gp | buildReg("SP") gpspg = gpg | buildReg("SP") gpspsbg = gpspg | buildReg("SB") - fp = buildReg("F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31") + fp = buildReg("F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31") lo = buildReg("LO") hi = buildReg("HI") callerSave = gp | fp | lo | hi | buildReg("g") // runtime.setg (and anything calling it) may clobber g diff --git a/src/cmd/compile/internal/ssa/gen/PPC64Ops.go b/src/cmd/compile/internal/ssa/gen/PPC64Ops.go index 09b6d316d0..a5d93bf3da 100644 --- a/src/cmd/compile/internal/ssa/gen/PPC64Ops.go +++ b/src/cmd/compile/internal/ssa/gen/PPC64Ops.go @@ -77,11 +77,11 @@ var regNamesPPC64 = []string{ "F24", "F25", "F26", - // "F27", // reserved for "floating conversion constant" - // "F28", // 0.0 - // "F29", // 0.5 - // "F30", // 1.0 - // "F31", // 2.0 + "F27", + "F28", + "F29", + "F30", + "F31", // "CR0", // "CR1", diff --git a/src/cmd/compile/internal/ssa/opGen.go b/src/cmd/compile/internal/ssa/opGen.go index ca5492ac0c..678ba183c3 100644 --- a/src/cmd/compile/internal/ssa/opGen.go +++ b/src/cmd/compile/internal/ssa/opGen.go @@ -10295,11 +10295,11 @@ var opcodeTable = [...]opInfo{ asm: arm64.AFADDS, reg: regInfo{ inputs: []inputInfo{ - {0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 - {1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 + {0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 + {1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 }, outputs: []outputInfo{ - {0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 + {0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 }, }, }, @@ -10310,11 +10310,11 @@ var opcodeTable = [...]opInfo{ asm: arm64.AFADDD, reg: regInfo{ inputs: []inputInfo{ - {0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 - {1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 + {0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 + {1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 }, outputs: []outputInfo{ - {0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 + {0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 }, }, }, @@ -10324,11 +10324,11 @@ var opcodeTable = [...]opInfo{ asm: arm64.AFSUBS, reg: regInfo{ inputs: []inputInfo{ - {0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 - {1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 + {0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 + {1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 }, outputs: []outputInfo{ - {0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 + {0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 }, }, }, @@ -10338,11 +10338,11 @@ var opcodeTable = [...]opInfo{ asm: arm64.AFSUBD, reg: regInfo{ inputs: []inputInfo{ - {0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 - {1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 + {0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 + {1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 }, outputs: []outputInfo{ - {0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 + {0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 }, }, }, @@ -10353,11 +10353,11 @@ var opcodeTable = [...]opInfo{ asm: arm64.AFMULS, reg: regInfo{ inputs: []inputInfo{ - {0, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 - {1, 288230375077969920}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 + {0, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 + {1, 4611686017353646080}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 }, outputs: []outputInfo{ - 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{0, 385057768005959680}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31 + {0, 576460752169205760}, // F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 }, }, }, @@ -13177,7 +13177,7 @@ var opcodeTable = [...]opInfo{ argLen: 1, clobberFlags: true, reg: regInfo{ - clobbers: 2114440025016893438, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 g F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31 HI LO + clobbers: 2305843009180139518, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 g F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 HI LO }, }, { @@ -13190,7 +13190,7 @@ var opcodeTable = [...]opInfo{ {1, 4194304}, // R22 {0, 67108862}, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 SP }, - clobbers: 2114440025016893438, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 g F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31 HI LO + clobbers: 2305843009180139518, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 g F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 HI LO }, }, { @@ -13199,7 +13199,7 @@ var opcodeTable = [...]opInfo{ argLen: 1, clobberFlags: true, reg: regInfo{ - clobbers: 2114440025016893438, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 g F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31 HI LO + clobbers: 2305843009180139518, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 g F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 HI LO }, }, { @@ -13208,7 +13208,7 @@ var opcodeTable = [...]opInfo{ argLen: 1, clobberFlags: true, reg: regInfo{ - clobbers: 2114440025016893438, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 g F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31 HI LO + clobbers: 2305843009180139518, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 g F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 HI LO }, }, { @@ -13220,7 +13220,7 @@ var opcodeTable = [...]opInfo{ inputs: []inputInfo{ {0, 33554430}, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 }, - clobbers: 2114440025016893438, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 g F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F25 F27 F29 F31 HI LO + clobbers: 2305843009180139518, // R1 R2 R3 R4 R5 R6 R7 R8 R9 R10 R11 R12 R13 R14 R15 R16 R17 R18 R19 R20 R21 R22 R24 R25 g F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 F10 F11 F12 F13 F14 F15 F16 F17 F18 F19 F20 F21 F22 F23 F24 F25 F26 F27 F28 F29 F30 F31 HI LO }, }, { @@ -16584,7 +16584,7 @@ var registersARM64 = [...]Register{ {62, "SB"}, } var gpRegMaskARM64 = regMask(133955583) -var fpRegMaskARM64 = regMask(288230375077969920) +var fpRegMaskARM64 = regMask(4611686017353646080) var specialRegMaskARM64 = regMask(0) var framepointerRegARM64 = int8(-1) var registersMIPS64 = [...]Register{ @@ -16652,7 +16652,7 @@ var registersMIPS64 = [...]Register{ {61, "SB"}, } var gpRegMaskMIPS64 = regMask(33554430) -var fpRegMaskMIPS64 = regMask(385057768005959680) +var fpRegMaskMIPS64 = regMask(576460752169205760) var specialRegMaskMIPS64 = regMask(1729382256910270464) var framepointerRegMIPS64 = int8(-1) var registersPPC64 = [...]Register{ @@ -16714,6 +16714,11 @@ var registersPPC64 = [...]Register{ {55, "F24"}, {56, "F25"}, {57, "F26"}, + {58, "F27"}, + {59, "F28"}, + {60, "F29"}, + {61, "F30"}, + {62, "F31"}, } var gpRegMaskPPC64 = regMask(536866812) var fpRegMaskPPC64 = regMask(288230371856744448) diff --git a/src/cmd/internal/obj/arm64/a.out.go b/src/cmd/internal/obj/arm64/a.out.go index 9a02452158..bed129d891 100644 --- a/src/cmd/internal/obj/arm64/a.out.go +++ b/src/cmd/internal/obj/arm64/a.out.go @@ -229,14 +229,10 @@ const ( REGZERO = REG_R31 REGSP = REG_RSP - FREGRET = REG_F0 - FREGMIN = REG_F7 // first register variable - FREGMAX = REG_F26 // last register variable for 7g only - FREGEXT = REG_F26 // first external register - FREGZERO = REG_F28 // both float and double - FREGHALF = REG_F29 // double - FREGONE = REG_F30 // double - FREGTWO = REG_F31 // double + FREGRET = REG_F0 + FREGMIN = REG_F7 // first register variable + FREGMAX = REG_F26 // last register variable for 7g only + FREGEXT = REG_F26 // first external register ) const ( diff --git a/src/cmd/internal/obj/mips/a.out.go b/src/cmd/internal/obj/mips/a.out.go index bc6b69df8d..eab65dda51 100644 --- a/src/cmd/internal/obj/mips/a.out.go +++ b/src/cmd/internal/obj/mips/a.out.go @@ -185,22 +185,18 @@ const ( REG_SPECIAL = REG_M0 - REGZERO = REG_R0 /* set to zero */ - REGSP = REG_R29 - REGSB = REG_R28 - REGLINK = REG_R31 - REGRET = REG_R1 - REGARG = -1 /* -1 disables passing the first argument in register */ - REGRT1 = REG_R1 /* reserved for runtime, duffzero and duffcopy */ - REGRT2 = REG_R2 /* reserved for runtime, duffcopy */ - REGCTXT = REG_R22 /* context for closures */ - REGG = REG_R30 /* G */ - REGTMP = REG_R23 /* used by the linker */ - FREGRET = REG_F0 - FREGZERO = REG_F24 /* both float and double */ - FREGHALF = REG_F26 /* double */ - FREGONE = REG_F28 /* double */ - FREGTWO = REG_F30 /* double */ + REGZERO = REG_R0 /* set to zero */ + REGSP = REG_R29 + REGSB = REG_R28 + REGLINK = REG_R31 + REGRET = REG_R1 + REGARG = -1 /* -1 disables passing the first argument in register */ + REGRT1 = REG_R1 /* reserved for runtime, duffzero and duffcopy */ + REGRT2 = REG_R2 /* reserved for runtime, duffcopy */ + REGCTXT = REG_R22 /* context for closures */ + REGG = REG_R30 /* G */ + REGTMP = REG_R23 /* used by the linker */ + FREGRET = REG_F0 ) const ( diff --git a/src/cmd/internal/obj/ppc64/a.out.go b/src/cmd/internal/obj/ppc64/a.out.go index 6b5bfde8f1..e1e624d962 100644 --- a/src/cmd/internal/obj/ppc64/a.out.go +++ b/src/cmd/internal/obj/ppc64/a.out.go @@ -132,29 +132,24 @@ const ( REG_LR = REG_SPR0 + 8 REG_CTR = REG_SPR0 + 9 - REGZERO = REG_R0 /* set to zero */ - REGSP = REG_R1 - REGSB = REG_R2 - REGRET = REG_R3 - REGARG = -1 /* -1 disables passing the first argument in register */ - REGRT1 = REG_R3 /* reserved for runtime, duffzero and duffcopy */ - REGRT2 = REG_R4 /* reserved for runtime, duffcopy */ - REGMIN = REG_R7 /* register variables allocated from here to REGMAX */ - REGCTXT = REG_R11 /* context for closures */ - REGTLS = REG_R13 /* C ABI TLS base pointer */ - REGMAX = REG_R27 - REGEXT = REG_R30 /* external registers allocated from here down */ - REGG = REG_R30 /* G */ - REGTMP = REG_R31 /* used by the linker */ - FREGRET = REG_F0 - FREGMIN = REG_F17 /* first register variable */ - FREGMAX = REG_F26 /* last register variable for 9g only */ - FREGEXT = REG_F26 /* first external register */ - FREGCVI = REG_F27 /* floating conversion constant */ - FREGZERO = REG_F28 /* both float and double */ - FREGHALF = REG_F29 /* double */ - FREGONE = REG_F30 /* double */ - FREGTWO = REG_F31 /* double */ + REGZERO = REG_R0 /* set to zero */ + REGSP = REG_R1 + REGSB = REG_R2 + REGRET = REG_R3 + REGARG = -1 /* -1 disables passing the first argument in register */ + REGRT1 = REG_R3 /* reserved for runtime, duffzero and duffcopy */ + REGRT2 = REG_R4 /* reserved for runtime, duffcopy */ + REGMIN = REG_R7 /* register variables allocated from here to REGMAX */ + REGCTXT = REG_R11 /* context for closures */ + REGTLS = REG_R13 /* C ABI TLS base pointer */ + REGMAX = REG_R27 + REGEXT = REG_R30 /* external registers allocated from here down */ + REGG = REG_R30 /* G */ + REGTMP = REG_R31 /* used by the linker */ + FREGRET = REG_F0 + FREGMIN = REG_F17 /* first register variable */ + FREGMAX = REG_F26 /* last register variable for 9g only */ + FREGEXT = REG_F26 /* first external register */ ) /* diff --git a/src/runtime/asm_arm64.s b/src/runtime/asm_arm64.s index df74cdcf3d..2fb4eeaadc 100644 --- a/src/runtime/asm_arm64.s +++ b/src/runtime/asm_arm64.s @@ -11,9 +11,6 @@ TEXT runtime·rt0_go(SB),NOSPLIT,$0 // SP = stack; R0 = argc; R1 = argv - // initialize essential registers - BL runtime·reginit(SB) - SUB $32, RSP MOVW R0, 8(RSP) // argc MOVD R1, 16(RSP) // argv @@ -100,15 +97,6 @@ TEXT runtime·breakpoint(SB),NOSPLIT,$-8-0 TEXT runtime·asminit(SB),NOSPLIT,$-8-0 RET -TEXT runtime·reginit(SB),NOSPLIT,$-8-0 - // initialize essential FP registers - FMOVD $4503601774854144.0, F27 - FMOVD $0.5, F29 - FSUBD F29, F29, F28 - FADDD F29, F29, F30 - FADDD F30, F30, F31 - RET - /* * go-routine */ diff --git a/src/runtime/asm_mips64x.s b/src/runtime/asm_mips64x.s index ec7ee6c96b..098de41053 100644 --- a/src/runtime/asm_mips64x.s +++ b/src/runtime/asm_mips64x.s @@ -14,9 +14,6 @@ TEXT runtime·rt0_go(SB),NOSPLIT,$0 // R29 = stack; R4 = argc; R5 = argv - // initialize essential registers - JAL runtime·reginit(SB) - ADDV $-24, R29 MOVW R4, 8(R29) // argc MOVV R5, 16(R29) // argv @@ -88,19 +85,6 @@ TEXT runtime·breakpoint(SB),NOSPLIT,$-8-0 TEXT runtime·asminit(SB),NOSPLIT,$-8-0 RET -TEXT _cgo_reginit(SB),NOSPLIT,$-8-0 - // crosscall1 needs to reginit, but can't - // get at the 'runtime.reginit' symbol. - JMP runtime·reginit(SB) - -TEXT runtime·reginit(SB),NOSPLIT,$-8-0 - // initialize essential FP registers - MOVD $0.5, F26 - SUBD F26, F26, F24 - ADDD F26, F26, F28 - ADDD F28, F28, F30 - RET - /* * go-routine */ diff --git a/src/runtime/asm_ppc64x.s b/src/runtime/asm_ppc64x.s index 874f6c68c4..3bff886375 100644 --- a/src/runtime/asm_ppc64x.s +++ b/src/runtime/asm_ppc64x.s @@ -106,12 +106,6 @@ TEXT _cgo_reginit(SB),NOSPLIT|NOFRAME,$0-0 TEXT runtime·reginit(SB),NOSPLIT|NOFRAME,$0-0 // set R0 to zero, it's expected by the toolchain XOR R0, R0 - // initialize essential FP registers - FMOVD $4503601774854144.0, F27 - FMOVD $0.5, F29 - FSUB F29, F29, F28 - FADD F29, F29, F30 - FADD F30, F30, F31 RET /* diff --git a/src/runtime/cgo/asm_arm64.s b/src/runtime/cgo/asm_arm64.s index e55a70fe64..925e930248 100644 --- a/src/runtime/cgo/asm_arm64.s +++ b/src/runtime/cgo/asm_arm64.s @@ -43,7 +43,6 @@ TEXT crosscall2(SB),NOSPLIT,$-8 MOVD R0, R19 // Initialize Go ABI environment - BL runtime·reginit(SB) BL runtime·load_g(SB) BL (R19) diff --git a/src/runtime/cgo/asm_mips64x.s b/src/runtime/cgo/asm_mips64x.s index 19e901443e..06439cf36a 100644 --- a/src/runtime/cgo/asm_mips64x.s +++ b/src/runtime/cgo/asm_mips64x.s @@ -46,7 +46,6 @@ TEXT crosscall2(SB),NOSPLIT,$-8 BGEZAL R0, 1(PC) SRLV $32, R31, RSB SLLV $32, RSB - JAL runtime·reginit(SB) JAL runtime·load_g(SB) JAL (R4) diff --git a/src/runtime/cgo/gcc_mips64x.S b/src/runtime/cgo/gcc_mips64x.S index adeb7aee8c..e0a1043009 100644 --- a/src/runtime/cgo/gcc_mips64x.S +++ b/src/runtime/cgo/gcc_mips64x.S @@ -35,8 +35,6 @@ crosscall1: sdc1 $f30, 136($29) sdc1 $f31, 144($29) - dla $23,_cgo_reginit - // prepare SB register = pc & 0xffffffff00000000 bal 1f 1: @@ -44,7 +42,6 @@ crosscall1: dsll $28, $28, 32 move $20, $4 // save R4 - jalr $23 // call _cgo_reginit, set up Go ABI constant registers move $1, $6 jalr $5 // call setg_gcc (clobbers R4) jalr $20 // call fn diff --git a/src/runtime/cgo_mips64x.go b/src/runtime/cgo_mips64x.go deleted file mode 100644 index f718e92912..0000000000 --- a/src/runtime/cgo_mips64x.go +++ /dev/null @@ -1,12 +0,0 @@ -// Copyright 2016 The Go Authors. All rights reserved. -// Use of this source code is governed by a BSD-style -// license that can be found in the LICENSE file. - -// +build mips64 mips64le - -package runtime - -// crosscall1 calls into the runtime to set up the registers the -// Go runtime expects and so the symbol it calls needs to be exported -// for external linking to work. -//go:cgo_export_static _cgo_reginit diff --git a/src/runtime/sys_linux_mips64x.s b/src/runtime/sys_linux_mips64x.s index d0141bce78..c9e03a24ce 100644 --- a/src/runtime/sys_linux_mips64x.s +++ b/src/runtime/sys_linux_mips64x.s @@ -238,9 +238,6 @@ TEXT runtime·sigtramp(SB),NOSPLIT,$64 SRLV $32, R31, RSB SLLV $32, RSB - // initialize essential registers (just in case) - JAL runtime·reginit(SB) - // this might be called in external code context, // where g is not set. MOVB runtime·iscgo(SB), R1 @@ -328,8 +325,6 @@ TEXT runtime·clone(SB),NOSPLIT,$-8 RET // In child, on new stack. - // initialize essential registers - JAL runtime·reginit(SB) MOVV -32(R29), R16 MOVV $1234, R1 BEQ R16, R1, 2(PC)